Hochschulschrift

Dynamisch und partiell rekonfigurierbare Hardwarearchitektur mit adaptivem hardwaregestützten Routing zur Laufzeit

Location
Deutsche Nationalbibliothek Frankfurt am Main
Extent
Online-Ressource
Language
Deutsch
Notes
Karlsruhe, Karlsruher Institut für Technologie (KIT), Diss., 2015

Classification
Informatik
Keyword
Architektur
Modul
Prozessor
Rekonfiguration
CUDA
Grafikprozessor
Anwendungsspezifischer Prozessor
FLOPS
CPLD
CISC
Datenpfad
CMOS

Event
Veröffentlichung
(where)
Karlsruhe
(who)
KIT-Bibliothek
(when)
2015
Creator
Contributor
Becker, J.

URN
urn:nbn:de:swb:90-536676
Rights
Der Zugriff auf das Objekt ist unbeschränkt möglich.
Last update
25.03.2025, 1:50 PM CET

Data provider

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Object type

  • Hochschulschrift

Associated

Time of origin

  • 2015

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